AK8146C AKM | Alldatasheet
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[AK8146C] MS1135-J-00 2009/10 - 1 - AK8146C Two Outputs Clock Generator AK8146Cは、42.72527473MHz、43.312500MHz、27.000MHz、72.000MHzのいずれかの入力クロックから、内 蔵 PLLで生成した12.0MHzと13.5Mzを出力するクロック・ジェネレータです。 特 長 □ 電源電圧： 2.7 – 3.6V □ 低消費電流： 5 mA typ. (出力端子無負荷) □ クロック入力： 42.72527473MHz, 43.31250000MHz, 27.000MHz, 72.000MHz （端子選択） □ 生成クロック CLK1 ： 12.0MHz CLK2 ： 13.5MHz □ 出力負荷 ： 15pF □ 低ジッタ出力 Period Jitter CLK1 ： 125ps max CLK2 ： 205ps max □ パッケージ： 8USON( 鉛フリー) 2.2mm x 2.2mm □ 用途 Digital Video Camera VDD CLK1 CLK2 SEL1 VSS PLL CLKIN 1/16 216MHz SEL0
[AK8146C] MS1135-J-00 2009/10 - 2 - １．端子説明 １－１）端子配置 1:SEL0 2:VSS 3:VDD 4:CLK1 8:CLKIN 7:VDD 6:SEL1 5:CLK2 １－２）端子機能説明 端子 番号 端子名 （タイプ） 説明
1 SEL0
(DI) 入力周波数選択端子0 CLKIN端子に入力するクロック周波数を選択します。 設定は、下表「入力周波数選択」を参照して下さい。
2 VSS
(PWR) 接地端子
3 VDD
(PWR) 電源端子
4 CLK1
(DO) クロック出力端子1 12.0MHzを出力します。
5 CLK2
(DO) クロック出力端子2 13.5MHzを出力します。
6 SEL1
(DI) 入力周波数選択端子1 CLKIN端子に入力するクロック周波数を選択します。 設定は、下表「入力周波数選択」を参照して下さい。
7 VDD
(PWR) 電源端子
8 CLKIN
(DI) クロック入力端子 SEL0,1端子で選択した周波数を入力します。 PWR：電源 DI:デジタル入力 DO:デジタル出力 入力周波数選択 SEL1 SEL0 入力周波数 0 0 42.72527473MHz (=405x1760x60/1.001) 0 1 43.31250000MHz (=462x1875x50) 1 0 27.000MHz 1 1 72.000MHz
[AK8146C] MS1135-J-00 2009/10 - 3 - ２．電気的特性 ２－１）絶対最大定格 注意：この値を超えた条件で使用した場合デバイスを破壊することがあります。 また、通常の動作は保証されません。 ２－２）動作条件 *VDD(pin3,7)は同じ電源を使用し、各端子とVSS間に0.1μF程度のコンデンサを挿入 してください。 *1 出力端子無負荷, CLKIN=42.72527473MHz入力(SEL[1,0]=[0,0]) TYP条件：VDD=3.0V, Ta=25℃ 項 目 記号 MIN MAX 単位 備考 電源電圧 VDD -0.3 4.6 V グランド・レベル VSS 0 0 V 入力端子電圧 VIN VSS-0.3 VDD+0.3 V 入力電流 IIN -10 10 mA 保存温度 Tstg -55 130 ℃ 項 目 記号 MIN TYP MAX 単位 備考 動作温度 Ta -20 85 ℃ 電源電圧 VDD 2.7 3.0 3.6 V 出力端子 負荷容量 Cpl pF CLK1 CLK2 項 目 記号 MIN TYP MAX 単位 備考 消費電流 IDD 5 6.4 mA *1
[AK8146C] MS1135-J-00 2009/10 - 4 - *1)設計値 *2)10,000サンプル, 5σ *3)電源がVDD電圧に達した後出力が所定の周波数の±100ppmに安定するまでの時間 *4)出力クロック周波数は入力周波数に比例します。 項目 端子 MIN TYP MAX 単位 備考 高ﾚﾍﾞﾙ入力電圧 SEL0 0.7*VDD V 低ﾚﾍﾞﾙ入力電圧 SEL0 0.3*VDD V 入力ﾘｰｸ電流 SEL0 -10 +10 μA 出力高ﾚﾍﾞﾙ電圧1 CLK1/2 0.8*VDD V IOH=-4mA 出力低ﾚﾍﾞﾙ電圧1 CLK1/2 0.2*VDD V IOL=4mA 出力高ﾚﾍﾞﾙ電圧2 CLK1/2 0.9*VDD V IOH=-1.5mA 出力低ﾚﾍﾞﾙ電圧2 CLK1/2 0.05*VDD V IOL=0.1mA 項目 端子 MIN TYP MAX 単位 備考 入力周波数1 入力周波数2 入力周波数3 入力周波数4 CLKIN 42.72527 43.31250 27.000 72.000 MHz 入力クロック振幅 CLKIN 0.7 Vpp 入力クロックDuty CLKIN 30 70 % 振幅の1/2で規定 出力クロック 周波数(*4) CLK1 12.0 MHz CLK2 13.5 MHz 出力クロック 立ち上がり時間 CLK1/2 4 ns Cp1=15pF 出力クロック 立ち下がり時間 CLK1/2 4 ns Cp1=15pF Period Jitter CLK1 125 ps *1,*2 CLK2 205 ps *1,*2 出力クロック Dutyサイクル CLK1/2 Cp1=15pF 出力ロック時間 CLK1 CLK2 1.4 2.8 ms Cp1=15pF
[AK8146C] MS1135-J-00 2009/10 - 5 - ３．パッケージ外形寸法図（単位ｍｍ） 0.50 0.25±0.05 1.20±0.05 1.90±0.05 2.20±0.05 2.20±0.05 0.60MAX 0.05 M S 0.05 S 0.20±0.05 ４．マーキング図 ａ． １ピン表示 丸印 ｂ． マーケティングコード １４６Ｃ ｃ． 日付コード XXX（3 桁） YMA 146C 実装強度の確保が必要な場合、 本部分は 基板のオープン面又は GND 面に実装し て下さい。
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