KS0075

KS0075 SAMSUNG | Alldatasheet

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KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 INTRODUCTION KS0075 is a dot matrix LCD driver & controller LSI which is fabricated by low power CMOS technology. It can display 1, 2, or 4 lines with 5 x 8 or 6 x 8 dots format. FUNCTIONS Character type dot matrix LCD driver & controller Internal driver : 34 common and 100 segment signal output Easy interface with 4-bit or 8-bit MPU Clock synchronized serial Interface 5 x 8 dot matrix possible 6 x 8 dot matrix possible Bi-directional shift function All character reverse display Display shift per line Voltage converter for LCD drive voltage : 13 V max (2 times / 3 times) Various instruction functions Automatic power on reset

FEATURES

• Character Generator ROM (CGROM) : 9,600 bits (240 characters x 5 x 8 dot) - Character Generator RAM (CGRAM) : 64 x 8 bits (8 characters x 5 x 8 dot) - Segment Icon RAM (SEGRAM) : 16 x 8 bits (96 icons max.) - Display Data RAM (DDRAM) : 80 x 8 bits (80 characters max.) Low power operation - Power supply voltage range : 2.7 5.5 V (VDD) - LCD Drive voltage range : 3.0 13.0 V (VDD - V5) CMOS process Programmable duty cycle : 1/17, 1/33 (refer to Table 1.) Internal oscillator with an external resistor Bare chip available

Table 1. Programmable duty cycles

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KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 PAD DESCRIPTION PAD (NO) INPUT/ OUTPUT NAME DESCRIPTION INTERFACE VDD (51) for logical circuit(+3V,+5V) VSS1,VSS2 (57,72) -0 V ( G N D ) V1V5 (7975) Power supply Bias voltage level for LCD driving. Power supply Vci (69) Input Input voltage to the voltage converter to generate LCD drive voltage(Vci = 1.0-4.5V). SEG1 SEG100 (97-163, 1-33) Output Segment output Segment signal output for LCD drive. LCD COM0 COM33 (8096, 3450) Output Common output Common signal output for LCD drive. LCD OSC1,OSC2 (53,52) Input (OSC1), Output (OSC2) Oscillator When use internal oscillator, connect external Rf resistor. If external clock is used, connect it to OSC1. External resistor/oscillator (OSC1) C1,C2 (71,70) Input External capacitance input To use the voltage converter(2 times /3 times), these pins must be connected to the external capacitance. External capacitance RESET (54) Input Reset pin Initialized to Low - IE (56) Input Select pin of instruction set When IE = "High", Instruction set is selected as Table 6. When IE = "Low", Instruction set is selected as Table 10. V5OUT2(73) Output Two times converter output The value of Vci is converted two times. To use three times converter, the same capacitance as that of C1-C2 should be connected here. capacitance V5OUT3(74) Three times converter output The value of Vci is converted three times. V5

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IM input, and 4-bit bus and 8-bit bus is selected by DL bit in the instruction register. During read or write operation, two 8-bit registers are used. one is data register (DR), the other is instruction register(IR). automatically. Also after MPU writes data to DR, the data in DR is transferred into DDRAM/CGRAM/SEGRAM automatically. To select register, use RS/CS input pin in 4-bit/8-bit bus mode(IM = "High") or RS bit in serial mode(IM = "Low"). Table 2. Various kinds of operations according to RS and R/W bits.

01 Read Busy flag(DB7) and address counter (DB0 DB6)

be accepted. BF can be read, when RS = Low and R/W = High(Read Instruction Operation), through DB7 port . Before executing the next instruction, be sure that BF is not High.

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 Display Data RAM (DDRAM) DDRAM stores display data of maximum 80 x 8 bits (80 characters). DDRAM address is set in the address counter (AC) as a hexadecimal number. (refer to Fig-1.) F i g - 1 . D D R A M A d d r e s s 1) Display of 5-dot font width character 5-dot 1 line display In the case of 1 line display with 5-dot font, the address range of DDRAM is 00H 4FH. (Refer to Fig-2) F i g - 2 . 1 - l i n e X 4 0 c h . d i s p l a y /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 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KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 5-dot 2 line display In the case of 2 line display with 5-dot font, the address range of DDRAM is 00H 27H, 40H 67H. (Refer to Fig-3) Fig-3. 2-line X 40ch. display (5-dot font width) /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0 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/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 66789 :;;<=>>> /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 ?@AABC DEFGCHBIJ D F D G D C DA DD DE DH DB DI DJ EA /G09 /G0A /G0D /G09 ED EE EF EG /G0A 6K>LM:N LO>KPKOQ EC EH EB EI EJ FA FD FE ?@AABC FF FG FC FH FB FI FJ GA /G09 /G0A /G0D /G0D /G09 /G0A /G0D /G0D /G0D /G09 /G0A /G0D DEFGCHBIJ D F D G D C DA DD DE DH DB DI DJ EA /G09 /G0A /G0D /G09 ED EE EF EG /G0A EC EH EB EI EJ FA FD FE FF FG FC FH FB FI FJ GA /G09 /G0A /G0D /G0D /G09 /G0A /G0D /G0D /G0D/G0D/G0D /G0D /G0D /G0D /G0D /G0D /G0D /G09 /G0A /G0D R8SP=< @TKSP U=SPV DEFGCHBIJ D F D G D C DA DD DE DH DB DI DJ EA /G09 /G0A /G0D /G09 ED EE EF EG /G0A EC EH EB EI EJ FA FD FE FF FG FC FH FB FI FJ GA /G09 /G0A /G0D /G0D /G09 /G0A /G0D /G0D /G0D /G09 /G0A /G0D R8SP=< @TKSP 7KWTPV

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 5-dot 4 line display In the case of 4 line display with 5-dot font, the address range of DDARM is 00H 13H, 20H 33H, 40H 53H, 60H 73H. (Refer to Fig-4) Fig-4. 4-line X 20ch. display (5-dot font width) /G09 /G0A /G0D /G09 /G0A /G0D /G09 /G0A /G09 /G0A /G0D /G09 /G0A /G0D /G0D /G0D /G0D/G0D/G0D /G0A/G0A /G09 /G0A /G0D /G09 /G0A /G0D /G09 /G0A /G0D /G09 /G0A /G09 /G0A /G0D /G09 /G0A /G0D /G09 /G0A /G0D /G09 /G0A /G0D /G09 /G0A /G0D /G09 /G0A /G09 /G0A /G0D /G09 /G0A /G0D /G09 /G0A /G0D /G09 /G0A /G09 /G0A /G09 /G0A

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 2) Display of 6-dot font width character When this device is used in 6-dot font width mode, SEG97,SEG98,SEG99 and SEG100 must be open. 6-dot 1 line display In the case of 1 line display with 6-dot font, the address range of DDRAM is 00H 4FH. (Refer to Fig-5) F i g - 5 . 1 - l i n e X 3 2 c h . d i s p l a y /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 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KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 6-dot 2 line display In the case of 2 line display with 6-dot font, the address range of DDRAM is 00H 27H, 40H 67H. (refer to Fig-6) F i g - 6 . 2 - l i n e X 3 2 c h . d i s p l a y ( 6 - d o t f o n t w i d t h ) /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 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/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /G09 /G0A /G0D /G09 /G0A /G0D /G09 /G0A /G09 /G0A /G09 /G0A /G0D /G09 /G0A /G0D /G09/G0A /G09 /G09 /G0D /G0D /G0D/G0D/G0D /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /G0D /G0D /G0A/G0A /G0D /G0D /G0A/G0A /G09 /G0A /G09 /G0A /G0D /G09 /G0A /G0D /G09 /G0A /G09 /G0A /G09 /G0A /G0D /G09 /G0A /G0D /G09/G0A /G09 /G09 /G09 /G0A /G09 /G0A /G0D /G09 /G0A /G0D /G09 /G0A /G09 /G0A /G09 /G0A /G0D /G09 /G0A /G0D /G09/G0A /G09 /G09 /G09 /G0A

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 6-dot 4 line display In the case of 4 line display with 6-dot font, the address range of DDARM is 00H 13H, 20H 33H, 40H 53H, 60H 73H. (refer to Fig-7) Fig-7. 4-line X 16ch. display (6-dot font width) /G09 /G0A /G0D /G09 /G0A /G0D /G09 /G0A /G09 /G0A /G0D /G09 /G0A /G0D /G0D /G0D /G0D/G0D/G0D /G0D /G0D /G0A/G0A /G09/G0A /G09 /G09 /G09 /G0A /G0D /G09 /G0A /G0D /G09 /G0A /G09 /G0A /G0D /G09 /G0A /G0D /G09/G0A /G09 /G09 /G09 /G0A /G0D /G09 /G0A /G0D /G09 /G0A /G09 /G0A /G0D /G09 /G0A /G0D /G09/G0A /G09 /G09

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 Timing Generation Circuit Timing generation circuit generates clock signals for the internal operations. Address Counter (AC) Address Counter(AC) stores DDRAM/CGRAM/SEGRAM address, transferred from IR. After writing into (reading from) DDRAM/CGRAM/SEGRAM, AC is automatically increased (decreased) by 1. When RS = "Low" and R/W = "High", AC can be read through DB0DB6 ports Cursor/Blink Control Circuit It controls cursor/blink ON/OFF and black/white inversion at cursor position. LCD Driver Circuit LCD Driver circuit has 34 common and 100 segment signals for LCD driving. Data from SEGRAM/CGRAM/CGROM is transferred to 100-bit segment latch serially, which is stored to 100-bit shift latch. When each common is selected by 34-bit common register, segment data also output through segment driver from 100-bit segment latch. In 1-line display mode, COM0 COM17 have 1/17 duty, and in 2-line or 4-line mode, COM0-COM33 have 1/33 duty ratio.

Table 3. CGROM Character Code Table

CGRAM has up to 5 X 8-dot 8 characters. By writing font data to CGRAM, user defined character can be used. Table 4. Relationship between Character Code(DDRAM) and Character Pattern(CGRAM)

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 2) 6x8 dot Character pattern 1. When BE(Blink Enable bit) = “HIGH”, blink is controlled by B1 and B0 bit. In displaying 5-dot font width, when B1 = "1", enabled dots of P0 P4 will blink, and when B1 = "0" and B0 = "1", enabled dots in P4 will blink, when B1 = "0" and B0 = "0", blink will not happen. In displaying 6-dot font width, when B1 = "1", enabled dots of P0 P5 will blink, and when B1 = "0" and B0 = "1", enabled dots of P5 will blink, when B1 = "0" and B0 = "0", blink will not happen. 2. "X" : Don't care ( )’ !!", /G00 /G00 /G00 /G00 /G00 /G00 /G00 /G00/G00/G00/G00/G00 /G00 /G00 /G00 /G00 /G00 /G00 !!", 4 4 4 4 4 /G00 /G00 /G00 /G00 /G00 /G00 /G00/G00/G00/G00/G00 /G00 /G00 /G00 /G00 /G00 /G00 !!",5

the data of SEGRAM enable to display icons. When used in 2/4-line display mode COM0(COM33) does that. Table 5. Relationship between SEGRAM address and display pattern

1. B1, B0 : Blinking control bit

0 X X No blink No blink

1. S1~S80 : Icon pattern ON/OFF in 5-dot font width

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 F i g - 8 . R e l a t i o n s h i p b e t w e e n S E G R A M a n d s e g m e n t d i s p l a y /G0D %&’ ( /G09 /G09 /G0A /G0D /G0A/G09 /G0A/G0A /G0A /G0A /G0D /G09 /G0A /G0D/G0D /G09 /G0A /G0D /G09 /G00/G00 /G0D %&’ ( $ /G0D /G09 /G0A /G0D /G09 /G0A /G0D /G09 /G0A /G09 /G0A /G0D /G09 /G0A /G0D /G09 /G0A /G0D /G00/G00

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 INSTRUCTION DESCRIPTION OUTLINE To overcome the speed difference between internal clock of KS0075 and MPU clock, KS0075performs internal operation by storing control information to IR or DR. The internal operation is determined according to the signal from MPU, composed of read/write and data bus. (refer to Table 6/10) Instruction can be divided largely four kinds, (1) KS0075 function set instructions ( set display methods, set data length, etc.) (2) address set instructions to internal RAM (3) data transfer instructions with internal RAM (4) others . The address of internal RAM is automatically increased or decreased by 1. When IE = "High", KS0075 is operated according to Instruction Set 1(Table 6) and when IE = "Low", KS0075 is operated according to Instruction Set 2(Table 10). * Note : During internal operation, Busy Flag (DB7) is read High. Busy Flag check must precede the next instruction. When an MPU program with Busy Flag(DB7) checking is made, 1/2 fosc (is necessary) for executing the next instruction by the falling edge of the “E” signal after the Busy Flag(DB7) goes to “Low”.

Table 6. Instruction Set 1 Assign cursor moving direction. and display shift enable bit. Segment bi-direction function.

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 ( T a b l e 6 . c o n t i n u e d ) Instruction RE Instruction Code Description Execution Time R S R/W DB7 DB6 DB5 DB4 DB3 DB2 DB1 DB0 (fosc = 270 kHz) Cursor or Display Shift 0 0 0 0 0 0 1 S/C R/L X X Cursor or display shift. S/C = "1" : display shift, S/C = "0" : cursor shift, R/L = "1" : shift to right, R/L = "0" : shift to left. 39 µs Shift Enable 1 0 0 0 0 0 1 DS4 DS3 DS2 DS1 (when DH = "1") Determine the line for display shift . DS1 = "1/0": 1st line display shift e n a b l e / d i s a b l e DS2 = "1/0": 2nd line display shift e n a b l e / d i s a b l e DS3 = "1/0": 3rd line display shift e n a b l e / d i s a b l e DS4 = "1/0": 4th line display shift e n a b l e / d i s a b l e . 39 µs Scroll Enable 1 0 0 0 0 0 1 HS4 HS3 HS2 HS1 (when DH = "0") Determine the line for horizontal smooth scroll. HS1 = "1/0" : 1st line dot scroll e n a b l e / d i s a b l e HS2 = "1/0" : 2nd line dot scroll e n a b l e / d i s a b l e HS3 = "1/0" : 3rd line dot scroll e n a b l e / d i s a b l e HS4 = "1/0" : 4th line dot scroll e n a b l e / d i s a b l e . 39 µs Function Set 0 0 0 0 0 1 DL N RE(0) DH REV Set interface data length (DL = "1" : 8-bit, DL = "0" : 4-bit), numbers of display line when NW = "0", (N = "1" : 2-line, N = "0" : 1-line), extension register, RE("0"), shift/scroll enable DH = "1" : display shift enable DH = "0" : dot scroll enable. reverse bit REV = "1" : reverse display, REV = "0" : normal display. 39 µs 1 0 0 0 0 1 D L N R E ( 1 ) B E 0 Set DL, N, RE("1") and CGRAM/SEGRAM blink enable (BE) BE = " 1/0" : CGRAM/SEGRAM blink enable/disable 39 µs

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 ( T a b l e 6 . c o n t i n u e d ) Instruction RE Instruction Code Description Execution Time R S R/W DB7 DB6 DB5 DB4 DB3 DB2 DB1 DB0 (fosc = 270 kHz) Set CGRAM Address 0 0 0 0 1 AC5 AC4 AC3 AC2 AC1 AC0 Set CGRAM address in address counter. 39 µs Set SEGRAM Address 1 0 0 0 1 X X AC3 AC2 AC1 AC0 Set SEGRAM address in address counter. 39 µs Set DDRAM Address 0 0 0 1 AC6 AC5 AC4 AC3 AC2 AC1 AC0 Set DDRAM address in address counter. 39 µs Set Scroll Quantity 1 0 0 1 X SQ5 SQ4 SQ3 SQ2 SQ1 SQ0 Set the quantity of horizontal dot scroll. 39 µs Read Busy flag and Address X 0 1 BF AC6 AC5 AC4 AC3 AC2 AC1 AC0 Can be known whether during internal operation or not by reading BF. The contents of address counter can also be read. BF = “1” : busy state, BF = “0” : ready state. 0 µs Write Data X 1 0 D 7 D 6 D 5 D 4 D 3 D 2 D 1 D 0 Write data into internal RAM (DDRAM / CGRAM / SEGRAM). 43 µs Read Data X 1 1 D 7 D 6 D 5 D 4 D 3 D 2 D 1 D 0Read data from internal RAM (DDRAM / CGRAM / SEGRAM). 43 µs * Note : 1. When an MPU program with Busy Flag(DB7) checking is made, 1/2 fosc (is necessary) for executing the next instruction by the “E” signal after the Busy Flag (DB7) goes to “Low”. 2 . “ X ” : D o n ’ t c a r e

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KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 4) Entry Mode Set (RE = 0) Set the moving direction of cursor and display. I/D : Increment / decrement of DDRAM address (cursor or blink) When I/D = "High", cursor/blink moves to right and DDRAM address is increased by 1. When I/D = "Low", cursor/blink moves to left and DDRAM address is decreased by 1. * CGRAM/SEGRAM operates the same as DDRAM, when read from or write to CGRAM/SEGRAM. When S = "High", after DDRAM write, the display of enabled line by DS1 - DS4 bits in the Shift Enable instruction is shifted to the right (I/D = "0") or to the left(I/D = "1"). But it will seem as if the cursor does not move. When S = "Low", or DDRAM read, or CGRAM/SEGRAM read/write operation, shift of display like this function is not performed. (RE = 1) Set the data shift direction of segment in the application set. BID : Data Shift Direction of Segment When BID = "Low", segment data shift direction is set to normal order from SEG1 to SEG100. When BID = "High", segment data shift direction is set to reverse from SEG100 to SEG1. By using this instruction, the efficiency of application board area can be raised. * The BID setting instruction is recommended to be set at the same time level of function set instruction. * DB1 bit must be set to "1". %/G0A %/G0A

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During 2-line mode display, cursor moves to the 2nd line after 40th digit of 1st line. In 4-line mode, cursor moves to the next line, only after every 20th digit of the current line. Note that display shift is performed simultaneously in all the line enabled by DS1 - DS4 in the Shift Enable instruction. When displayed data is shifted repeatedly, each line shifted individually. When display shift is performed, the contents of address counter are not changed. During low power consumption mode, display shift may not be performed normally. Table 7. Shift patterns according to S/C and R/L bits

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 8) Shift/Scroll Enable (RE = 1) (DH = 0) /G09 /G0A /G0D HS : Horizontal Scroll per Line Enable This instruction makes valid dot shift by a display line unit. HS1, HS2, HS3 and HS4 indicate each line to be dot scrolled, and each scroll is performed individually in each line. If the line in 1-line display mode or the 1st line in 2-line display mode, is to be scrolled set HS1 and HS2 to "High". If the 2nd line scroll is needed in 2-line mode, set HS3 and HS4 to "High". (refer to Table 8) (DH = 1) DS : Display Shift per Line Enable This instruction selects shifting line to be shifted according to each line mode in display shift right/left instruction. DS1, DS2, DS3 and DS4 indicate each line to be shifted, and each shift is performed individually in each line. If DS1 and DS2 is set to "High" (enable) in 2 line mode, only the 1st line is shifted and the 2nd line is not shifted. When only DS1 = "High", only the half of the 1st line is shifted. If all the DS bits (DS1 to DS4) are set to "Low" (disable), no display is shifted. Table 8. Relationship between DS and COM signal

Description

HS1/DS1 COM1 COM8 The part of display line that corresponds to enabled HS2/DS2 COM9 COM16 common signal can be shifted. HS3/DS3 COM17 COM24 HS4/DS4 COM25 COM32 /G09 /G0A /G0D

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KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 (RE = 1) DL : Interface data length control bit When DL = "High", it means 8-bit bus mode with MPU. When DL = "Low", it means 4-bit bus mode with MPU. Hence, DL is a signal to select 8-bit or 4-bit bus mode. When 4-bit bus mode, it is required to transfer 4-bit data twice. N : Display line number control bit It is variable only when NW bit of extended function set instruction is Low. When N = "Low", 1-line display mode is set. When N = "High", 2-line display mode is set. When NW = "High", N bit is invalid, it means 4-line mode independent of N bit. RE : Extended function registers enable bit When RE = "High", extended function set registers, SEGRAM address set registers, BID bit, HS/DS bits of shift/scroll enable instruction and BE bits of function set register can be accessed. BE : CGRAM/SEGRAM data blink enable bit BE =”High”, makes user font of CGRAM and segment of SEGRAM blinking. The quantity of blink is assigned the highest 2 bit of CGRAM/SEGRAM. 10) Set CGRAM Address (RE = 0) Set CGRAM address to AC. This instruction makes CGRAM data available from MPU. 11) Set SEGRAM Address (RE = 1) Set CGRAM address to AC. This instruction makes CGRAM data available from MPU. /G09 $ ! 8 5 ’ 4 1 / & ! /G0D/G0D/G0D/G0D /G0D /G0D /G09 /G0A /G0D /G0D /G0A /G09

This instruction makes DDRAM data available from MPU. In 1-line display mode (N = 0, NW = 0), DDRAM address is from "00H" to "4FH". and DDRAM address in the 2nd line is from "40H" to "67H". Table 9. Scroll quantity according to HDS bits

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 14) Read Busy Flag & Address This instruction shows whether KS0075 is in internal operation or not. If the resultant BF is High, the internal operation is in progress and you have to wait until BF to be Low, which by then the next instruction can be performed. In this instruction the value of address counter can also be read. 15) Write data to RAM Write binary 8-bit data to DDRAM/CGRAM/SEGRAM. The selection of RAM from DDRAM, CGRAM, or SEGRAM, is set by the previous address set instruction : DDRAM address set, CGRAM address set, SEGRAM address set. RAM set instruction can also determines the AC direction to RAM. After write operation, the address is automatically increased/decreased by 1, according to the entry mode. 16) Read data from RAM Read binary 8-bit data from DDRAM/CGRAM/SEGRAM. The selection of RAM is set by the previous address set instruction. If address set instruction of RAM is not performed before this instruction, the data that read first is invalid, as the direction of AC is not determined. If RAM data is read several times without RAM address set instruction before read operation, the correct RAM data can be obtained from the second, but the first data would be incorrect, as there is no time margin to transfer RAM data. In DDRAM read operation, cursor shift instruction plays the same role as DDRAM address set instruction : it also transfer RAM data to output data register. After read operation address counter is automatically increased/decreased by 1 according to the entry mode. After CGRAM/SEGRAM read operation, display shift may not be executed correctly. In case of RAM write operation, AC is increased/decreased by 1 as in read operation after this. In this time, AC indicates the next address position, but the previous data can only be read by read instruction. A D XY 8ZH 8ZC 8ZG 8ZF 8ZE 8ZD 8ZA /G09 /G0A /G0D /G09 /G0A /G0D /G09 /G0A /G0D /G09 /G0A /G0D /G09 /G0A /G0D

Table 10. Instruction Set 2 Assign cursor moving direction. and display shift enable bit. cursor, and 4-line display mode control bit.

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KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 1) Display Clear Clear all the display data by writing "20H" (space code) to all DDRAM address, and set DDRAM address to "00H" into AC (address counter). Return cursor to the original status, hence, bring the cursor to the left edge on first line of the display. And entry mode is set to increment mode (I/D = "1"). 2) Return Home Return Home is cursor return home instruction. Set DDRAM address to "00H" into the address counter. Return cursor to its original site and return display to its original status, if shifted. Contents of DDRAM does not change. 3) Entry Mode Set Set the moving direction of cursor and display. I/D : Increment / decrement of DDRAM address (cursor or blink) When I/D = "High", cursor/blink moves to right and DDRAM address is increased by 1. When I/D = "Low", cursor/blink moves to left and DDRAM address is decreased by 1. * CGRAM/SEGRAM operates identically to the DDRAM, when reading from or writing to CGRAM/SEGRAM. When S = "High", after DDRAM write, the entire display of all lines is shifted to the right (I/D = "0") or to the left(I/D = "1"). But it will seem as if the cursor does not moving. When S = "Low", or DDRAM read, or CGRAM/SEGRAM read/write operation, shift of entire display is not performed. /G0D /G09 /G0A /G0D /G0D /G09 /G0A /G0D /G0A /G0A /G0A /G0A /G0A /G0A /G0A &#

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 4) Display ON/OFF Control ( RE = 0 ) Control display/cursor/blink ON/OFF 1 bit register. D : Display ON/OFF control bit When D = "High", entire display is turned on. When D = "Low", display is turned off, but display data is remained in DDRAM. C : Cursor ON/OFF control bit When C = "High", cursor is turned on. When C = "Low", cursor is disappeared in current display, but I/D register remains its data. B : Cursor Blink ON/OFF control bit When B = "High", cursor blink is on, that performs alternate between all the high data and display character at the cursor position. If fosc has 270 kHz frequency, blinking has 370 ms interval. When B = "Low", blink is off. 5) Extended Function Set ( RE = 1 ) FW : Font Width control When FW = "High", display character font width is assigned to 6-dot and execution time becomes 6/5 times than that of 5-dot font width. The user font, specified in CGRAM, is displayed into 6-dot font width, bit-5 to bit-0,including the leftmost space bit of CGRAM.(Refer to Fig-10) When FW = "Low", 5-dot font width is set. B/W : Black/White Inversion enable bit When B/W = "High", black/white inversion at the cursor position is set. In this case C/B bit of display ON/OFF control instruction becomes don't care condition. If fosc has frequency of 270 kHz, inversion has 370 ms intervals. NW : 4 Line mode enable bit When NW = "High", 4 line display mode is set. In this case N bit of function set instruction becomes don't care condition. $ ’ /G0D /G0A /G09 /G0A /G0A /G0A /G0A /G0A /G0A &$ %#$ ’$ 8 5 ’ 4 1 / & !

During 2-line mode display, cursor moves to the 2nd line after 40th digit of 1st line. In 4-line mode, cursor moves to the next line, only after every 20th digit of the current line. Note that display shift is performed simultaneously in all the line. When displayed data is shifted repeatedly, each line shifted individually. When display shift is performed, the contents of address counter are not changed. Table 11. Shift patterns according to S/C and R/L bits

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KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 (RE = 1) DL : Interface data length control bit When DL = "High", it means 8-bit bus mode with MPU. When DL = "Low", it means 4-bit bus mode with MPU. Hence, DL is a signal to select 8-bit or 4-bit bus mode. In 4-bit bus mode, it is required to transfer 4-bit data twice. N : Display line number control bit It is variable only when NW bit of extended function set instruction is Low. When N = "Low", 1-line is set. When N = "High", 2-line display mode is set. When NW = "High", N bit is invalid, 4-line mode independent of N bit. RE : Extended function registers enable bit When RE = "High", extended function set registers, SEGRAM address set registers, HS bits of scroll enable instruction and BE bits of function set register can be accessed. BE : CGRAM/SEGRAM data blink enable bit If BE is "High", makes user font of CGRAM and segment of SEGRAM blinking. The quantity of blink is assigned the highest 2 bit of CGRAM/SEGRAM. 9) Set CGRAM Address (RE = 0) Set CGRAM address to AC. This instruction makes CGRAM data available from MPU. 10) Set SEGRAM Address (RE = 1) Set SEGRAM address to AC. This instruction makes SEGRAM data available from MPU. /G0A /G0A /G0A /G0A $ ! 8 5 ’ 4 1 / & ! /G0D/G0D/G0D/G0D /G0D /G0D /G09 /G0A /G0D & & /G0D/G0D /G0D /G0D /G09 /G0A /G0D

This instruction makes DDRAM data available from MPU. In 1-line display mode (N = 0, NW = 0), DDRAM address is from "00H" to "4FH". and DDRAM address in the 2nd line is from "40H" to "67H". "20H" to "33H" in the 2nd line, from "40H" to "53H" in the 3rd line and from "60H" to "73H" in the 4th line. Setting SQ5 to SQ0, horizontal scroll quantity can be controlled in dot units. (Refer to Table 12). In this case of KS0075 execute dot smooth scroll from 1 to 48 dots. Table 12. Scroll quantity according to HDS bits

000000 N o s h i f t

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 13) Read Busy Flag & Address This instruction shows whether KS0075 is in internal operation or not. If the resultant BF is High, it means the internal operation is in progress and should to wait until BF to become “Low”. Which by then the next instruction can be performed. In this instruction value of address counter can also be read. 14) Write data to RAM Write binary 8-bit data to DDRAM/CGRAM/SEGRAM. The selection of RAM from DDRAM, CGRAM, or SEGRAM, is set by the previous address set instruction : DDRAM address set, CGRAM address set, SEGRAM address set. RAM set instruction can also determines the AC direction to RAM. After write operation, the address is automatically increased/decreased by 1, according to the entry mode. 15) Read data from RAM Read binary 8-bit data from DDRAM/CGRAM/SEGRAM. The selection of RAM is set by the previous address set instruction. If address set instruction of RAM is not performed before this instruction, the data that read first is invalid, as the direction of AC is not determined. If the RAM data is read several times without RAM address set instruction before read operation, the correct RAM data from the second, but the first data would be incorrect, as there is no time margin to transfer RAM data. In case of DDRAM read operation, cursor shift instruction plays the same role as DDRAM address set instruction : it also transfer RAM data to output data register. After read operation address counter is automatically increased/decreased by 1 according to the entry mode. After CGRAM/SEGRAM read operation, display shift may not be executed correctly. * In case of RAM write operation, AC is increased/decreased by 1 like read operation after this. In this time, AC indicates the next address position, but the previous data can only be read by read instruction. /G0D /G09 /G0A /G0D /G09 /G0A /G0D /G09 /G0A /G0D /G09 /G0A /G0D /G0D /G0D /G09 /G0A /G0D /G09 /G0A /G0D

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 INTERFACE WITH MPU KS0075 can transfer data in bus mode (4-bit or 8-bit) or serial mode with MPU. Hence, both types of 4 or 8-bit MPU can be used. In case of 4-bit bus mode, data transfer is performed by twice to transfer 1 byte data. (1) When interfacing data length are 4-bit, only 4 ports, from DB4 to DB7, are used as data bus. At first higher 4-bit (in case of 8-bit bus mode, the contents of DB4 - DB7) are transferred, and then lower 4-bit (in case of 8-bit bus mode, the contents of DB0 - DB3) are transferred. So transfer is performed by twice. Busy Flag outputs "High" after the second transfer is ended. (2) When interfacing data length are 8-bit, transfer is performed at a time through 8 ports, from DB0 to DB7. (3) If IM is set to "Low", serial transfer mode is set.

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 Interface with MPU in Bus Mode 1) Interface with 8-bits MPU If 8-bits MPU is used, KS0075 can connect directly with that. In this case, port E, RS, R/W and DB0 to DB7 need to interface each other. Example of timing sequence is shown below. Fig 11. Example of 8-bit Bus Mode Timing Sequence 2) Interface with 4-bits MPU If 4-bits MPU is used, KS0075 can connect directly with this. In this case, port E, RS, R/W and DB4 to DB7 need to interface each other. The transfer is performed by twice. Example of timing sequence is shown below. F i g 1 2 . E x a m p l e o f 4 - b i t B u s M o d e T i m i n g S e q u e n c e RS R/W E DB7 Internal signal Busy BusyDATA DATA Internal operatio n Busy Fla g Check Busy Fla g Check Busy Fla g CheckINSTRUCTION INSTRUCTION No Busy RS R/W E DB7 Internal signal Busy Internal operatio n Busy Fla g Check Busy Fla g CheckINSTRUCTION INSTRUCTION No Busy D3D7AC3AC3D3D7

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 Interface with MPU in Serial Mode When IM port input is "Low", serial interface mode is started. At this time, all three ports, SCLK (synchronizing transfer clock), SID (serial input data), and SOD (serial output data), are used. If KS0075 is to be used with other chips, chip select port (cs) be used. By setting CS to "Low", KS0075 can receive SCLK input. If CS is set to "High", KS0075 reset the internal transfer counter. Before transfer real data, start byte has to be transferred. It is composed of succeeding 5 "High" bits, read write control bit (R/W), register selection bit (RS), and end bit that indicates the end of start byte. Whenever succeeding 5 "High" bits are detected by KS0075, it resets serial transfer counter and prepares to receive next information. The next input data are register selection bit which determine which register is to be used, and read write control bit that determine the direction of data. Then end bit is transferred, which must have "Low" value to show the end of start byte. (Refer to Fig 13. Fig 14) (1) Write Operation (R/W = 0) After start byte is transferred from MPU to KS0075, 8-bit data is transferred which is divided into 2 bytes, each byte has 4 bit's real data and 4 bit's partition token data. For example, if real data is "10110001" (D0 - D7), then serially transferred data becomes "1011 0000 0001 0000" where 2nd and 4th 4 bits must be "0000" for safe transfer. To transfer several bytes continuously without changing R/W bit and RS bit, start byte transfer is needed only at first starting time. I.e., after first start byte is transferred, real data succeeding can be transferred. (2) Read Operation (R/W = 1) After start byte is transferred to KS0075, MPU can receive 8-bit data through the SOD port at a time from the LSB. Wait time is needed to insert between start byte and data reading, as internal reading from RAM requires some delay. Continuous data reading is possible such as serial write operation. It also needs only one start bytes, only if some delay between reading operations of each byte is inserted. During the reading operation, KS0075 observes succeeding 5 "High" from MPU. If detected, KS0075 restarts serial operation at once and prepares to receive RS bit. So in continuous reading operation, SID port must be "Low".

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 F i g 1 3 . T i m i n g D i a g r a m o f S e r i a l D a t a T r a n s f e r 123456789 1 0 1 1 1 2 1 3 1 4 1 5 1 6 Starting Byte Instruction Starting By te Read Data (1) Seria l Write Operatio n (2) Seria l Read Operatio n CS SID CS SCLK SID D0 D1 D2 D3 D4 D5 D6 D7Invalid DataSOD (Input) (Input) (Input) Synchronizing Lower Data 1'st Byte Upper Data 2'nd Byte (Input) (Input) (Input) (Output) Synchronizing Lower Upper Busy Fla g/ /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 Data DataBit string Bit string

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 F i g 1 4 . T i m i n g D i a g r a m o f C o n t i n u o u s D a t a T r a n s f e r (1) Continuous Write Operatio n SCLK 1st byte 2nd byteStart by te (Instruction1) 1st byte 2nd byte (Instructio n2) 1st byte 2nd byte (Instructio n3) Instructio n1 execution time Instructio n2 executio n time Instructio n3 executio n time SID Start by te Data read1 Data read2 Data read3 Instruction1 executio n time Instructio n2 executio n time Instruction3 executio n time SCLK SID SOD (2) Continuous Read Operatio n Wai t Wai t Wai t WaitWait

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 APPLICATION INFORMATION ACCORDING TO LCD PANEL 1) LCD Panel : 40 character x 1 line format (5-dot font,1/17 duty) 2) LCD Panel : 40 character x 2 line format (5-dot font, 1/33 duty) /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0 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KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 3) LCD Panel : 20 character x 4 line format (5-dot font, 1/33 bias) /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0 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KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 4) LCD Panel : 16 character x 4 line format (6-dot font, 1/33 bias) /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0 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/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0 /i0/i0/i0 /i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 INITIALIZING 1) Initializing by Internal Reset Circuit When the power is turned on, KS0075 is initialized automatically by power on reset circuit. During the initialization, the following instructions are executed, and BF(Busy Flag) is kept "High"(busy state) to the end of initialization. Display Clear instruction Write "20H" to all DDRAM Set Functions instruction DL = 1 : 8-bit bus mode N = 1 : 2-line display mode RE = 0 : Extension register disable BE = 0 : CGRAM/SEGRAM blink OFF DH = 0 : Horizontal scroll enable REV = 0 : Normal display (Not reversed display) Control Display ON/OFF instruction D = 0 : Display OFF C = 0 : Cursor OFF B = 0 : Blink OFF /G09 Set Entry Mode instruction I/D = 1 : Increment by 1 S = 0 : No entire display shift BID = 0 : Normal direction segment port /G0A Set Extension Function instruction FW = 0 : 5-dot font width character display B/W = 0 : Normal cursor (8th line) NW = 0 : Not 4-line display mode, 2-line mode is set because of N("1") Enable Shift instruction HS = 0000 : Scroll per line disable DS = 0000 : Shift per line disable Set scroll Quantity instruction SQ = 000000 : Not scroll 2) Initializing by Hardware RESET input When RESET pin = "Low", KS0075 can be initialized like the case of power on reset. During the power on reset operation, this pin is ignored.

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 INITIALIZING BY INSTRUCTION 1) 8-bit interface mode Power on Wait for more than 20 ms after VDD rises to 4.5V Wait for more than 39µs Wait for more than 39µs Wait for more than 1.53ms Initialization end (DL=“1”) DL N 4-bit interface 8-bit interface 1-line mode 2-line mode 0 display off D C display on cursor off cursor on blink off blink on 0 decrement mode I/D S increment mode entire shift off entire shift on RS RW DB6 DB5 DB4 DB3 DB2 DB1 DB0 0 001 DL (1) N0x x Function set DB7 RS RW DB6 DB5 DB4 DB3 DB2 DB1 DB0 0 000 0 0 00 1 ClearDsplay DB7 RS RW DB6 DB5 DB4 DB3 DB2 DB1 DB0 0 000 0 0 1I / DS Entry Mode Set DB7 RS RW DB6 DB5 DB4 DB3 DB2 DB1 DB0 0 000 0 1 DC B Dsplay ON/OFF Control DB7 Condition: 270 kHz

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 2) 4-bit interface mode Power on Wait for more than 20 ms after VDD rises to 4.5V Wait for more than 39µs RS RW DB6 DB5 DB4 DB3 DB2 DB1 DB0 0 00 1 0 x xx x Function set Wait for more than 39µs Wait for more than 39µs Initialization end (DL=“0”) DL N 4-bit interface 8-bit interface 1-line mode 2-line mode 0 display off D C display on cursor off cursor on blink off blink on 0 decrement mode I/D S increment mode entire shift off entire shift on x xx xx x0 0 N RS RW DB6 DB5 DB4 DB3 DB2 DB1 DB0 0 00 1 DL (0) xxxx Function set DB7 DB7 x RS RW DB6 DB5 DB4 DB3 DB2 DB1 DB0 0 000 0 x xx x Dsplay ON/OFF Control 0 1D C Bx xx x DB7 RS RW DB6 DB5 DB4 DB3 DB2 DB1 DB0 0 000 0 x xx x Clear Dsplay 0 000 1x xx x DB7 Wait for more than 1.53ms RS RW DB6 DB5 DB4 DB3 DB2 DB1 DB0 0 000 0 x xx x Entry ModeSet

0 I/D S xxxx

Condition: 270 kHz

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0 /i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0/i0 EXAMPLE OF INSTRUCTION AND DISPLAY CORRESPONDENCE 1) IE = "Low" /G09/G0A/G09 /G09 /G09/G0D/G09/G09/G09/G09 %& %’( /G09/G0A/G09 /G09 /G09/G0D/G09/G09/G09/G09 ) ) +,! - , - ./0 /G09/G0A/G09 /G09 /G09/G0D/G09/G09/G09/G09 121** & /G09/G0A/G09 /G09 /G09/G0D/G09/G09/G09/G09 /G0D. /G09/G0A/G09 /G09 /G09/G0D/G09/G09/G09/G09 /G09/G0A/G09 /G09 /G09/G0D/G09/G09/G09/G09 /G09/G0A/G09 /G09 /G09/G0D/G09/G09/G09/G09 /G0A /G09/G0A/G09 /G09 /G09/G0D/G09/G09/G09/G09

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD 89 7:!" $ 9 7:!" $ 9 7:!" $ 1 1 > * :?! ", /=" 9 7:!" $ 9 7:!" $ /G09 9 7:!" $

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD /G09/G0A/G09 /G09 /G09/G0D/G09/G09/G09/G09 /G09/G09 /G0A /G09/G0A/G09 /G09 /G09/G0D/G09/G09/G09/G09 /G09/G09/G0A /G0A /G09/G0A/G09 /G09 /G09/G0D/G09/G09/G09/G09 /G09/G09/G0A /G09/G0A/G09 /G09 /G09/G0D/G09/G09/G09/G09 ) ) /G09/G09/G0A &# #" /G09/G0A/G09 /G09 /G09/G0D/G09/G09/G09/G09 /G09/G09/G0A /G09/G0A/G09 /G09 /G09/G0D/G09/G09/G09/G09 ) /G09/G09/G0A /G09/G0A/G09 /G09 /G09/G0D/G09/G09/G09/G09

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD 2) IE = "High" /G0D/G0D./G0A / /G0A /G0D /G0A/G09 /G0A/G09 /G09/G0A /G0A 0/G0D/G090+/G0D ) &+0 /G0D /G0A , "//G0D 1 %$ /G0D 2342&& 5 /G09 , /G0D 45+/G09 /G09 ) &+0 /G0D /G0A , % ) ’/G09/G0D /G0A , ’/G09/G0D /G0A ) 6 /G0A/G0A &+0 /G0D /G0A 1 /G0D/G0A

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD 7. Write data to DDRAM : Write A RS RW DB7 DB6 DB5 DB4 DB3 DB2 DB1 DB0 1 0 0 1 0 0 0 1 1 1 12. Write data to DDRAM : Write G RS RW DB7 DB6 DB5 DB4 DB3 DB2 DB1 DB0 0 0 1 0 1 0 0 0 0 0 13. Set DDRAM Addres s 20H SA_ SAMSUNG SAMSUNG_ RS RW DB7 DB6 DB5 DB4 DB3 DB2 DB1 DB0 1 0 0 1 0 0 1 0 1 1 14. Write data to DDRAM : Write K RS RW DB7 DB6 DB5 DB4 DB3 DB2 DB1 DB0 1 0 0 0 1 1 0 1 0 1 19. Write data to DDRAM : Write 5 RS RW DB7 DB6 DB5 DB4 DB3 DB2 DB1 DB0 0 0 1 1 0 0 0 0 0 0 20. Set DDRAM Addres s 40H SAMSUNG SAMSUNG KS0075 SAMSUNG KS0075_

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KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD FRAME FREQUENCY 1) 1/17 duty cycle Item Display Font Width 5-dot font width 6-dot font width 1-line selection period 200 clocks 240 clocks Frame frequency 79.4Hz 66.2Hz * f o s c = 2 7 0 k H z ( 1 c l o c k = 3 . 7µs) 2) 1/33 duty cycle Item Display Font Width 5-dot font width 6-dot font width 1-line selection period 100 clocks 120 clocks Frame frequency 81.8Hz 68.2Hz fosc = 270 kHz (1 clock = 3.7 µs)

1. Boosted output voltage should not exceed the maximum value (13 V) of the LCD driving

( V c i ) w h e n b o o s t i n g t h r e e t i m e s .

1. A voltage of over 5.5V should not be input to the reference voltage (Vci) when boosting
2. The value of resistance, according to the number of lines, duty ratio and the bias, is

Table 13. Duty Ratio and Power Supply for LCD Driving

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD MAXIMUM ABSOLUTE RATE Characteristic Symbol Value Unit Power Supply Voltage (1) V DD -0.3 ~ +7.0 V Power Supply Voltage (2) V LCD VDD -15.0 ~ VDD +0.3 V Input Voltage V IN -0.3 ~ VDD +0.3 V Operating Temperature T OPR -30 ~ +85 oC Storage Temperature T STG -55 ~ +125 oC Voltage greater than above may damage to the circuit (VDD≥V1≥V2≥V3≥V4≥V5)

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ELECTRICAL CHARACTERISTICS

Characteristic Symbol Condition Min Typ Max Unit Operating Voltage V DD - 2.7 - 5.5 V Supply Current I DD Internal oscillation or external clock. (VDD =3.0V,fosc=270KHz) - 0.15 0.3 mA Input Voltage (1) V IH1 -0 . 7 V DD -V DD (Except OSC1) V IL1 VDD =2.7 to 3.0 -0.3 - 0.2V DD - Input Voltage (2) V IH2 -0 . 7 V DD -V DD V (Osc1) V IL2 -- - 0 . 2 V DD Output Voltage (1) V OH1 IOH =-0.1 mA 0.75V DD -- V (DB0 To DB7) V OL1 IOL =0.1 mA - - 0.2V DD Output Voltage(2) V OH2 IO =-40 µA 0.8VDD -- V (Except DB0 To Db7) V OL1 IO =40 µA - - 0.2V DD Voltage Drop Vd COM IO = 0.1mA -- 1 V VdSEG -- 1 Input Leakage Current I LKG VIN=0V to VDD -1 - 1 µA Low Input Current I IL VIN=0V, VDD =3V (PULL UP) -10 -50 -120 Internal Clock (external Rf) fOSC Rf=91[kΩ ] (VDD =5V) 190 270 350 KHz External Clock f EC 125 270 410 KHz duty - 45 50 55 % tR , tF -- 0 . 2 µs Voltage Converter Out2 (Vci = 4.5V) VOUT2 Ta = 25/G0D, C=1µF, IOUT = 0.25mA, -3.0 -4.2 - V Voltage Converter Out3 (Vci = 2.7V) VOUT3 fOSC =270KHz -4.3 -5.1 - Voltage Converter Input Vci - 1.0 - 4.5 LCD Driving Voltage V LCD VDD -V5 1/5 Bias 3.0 - 13.0 V 1/6.7 Bias 3.0 - 13.0

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD AC Characteristics Mode Item Symbol Min Typ Max Unit E Cycle Time tc, 500 - - E Rise / Fall Time t R , tF -- 2 0 E Pulse Width (High, Low) tw 230 - - ns (1) Write Mode R/W and RS Setup Time tsu1 40 - - (refer to Fig-15) R/W and RS Hold Time t H 11 0 - - Data Setup Time tsu2 60 - - Data Hold Time t H 21 0 - - E Cycle Time tc 500 - - E Rise / Fall Time t R ,tF -- 2 0 E Pulse Width (High, Low) tw 230 - - ns (2) Read Mode R/W and RS Setup Time tsu 40 - - (refer to Fig-16) R/W and RS Hold Time t H 10 - - Data Output Delay Time t D - - 160 Data Hold Time t DH 5-- Serial Clock Cycle Time tc 0.5 - 20 µs Serial Clock Rise/Fall Time t R ,tF -- 5 0 Serial Clock Width (High, Low) tw 200 - - (3) Serial Chip Select Setup Time tsu1 60 - - Interface Mode Chip Select Hold Time t H1 20 - - ns (refer to Fig-17) Serial Input Data Setup Time tsu2 100 - - Serial Input Data Hold Time t H2 100 - - Serial Output Data Delay Time t D - - 160 Serial Output Data Hold Time t DH 5--

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD AC Characteristics (continued) Mode Item Symbol Min Typ Max Unit E Cycle Time tc, 1000 - - E Rise / Fall Time t R , tF -- 2 5 E Pulse Width (High, Low) tw 450 - - ns (4) Write Mode R/W and RS Setup Time tsu1 60 - - (refer to Fig-15) R/W and RS Hold Time t H 12 0 - - Data Setup Time tsu2 195 - - Data Hold Time t H 21 0 - - E Cycle Time tc 1000 - - E Rise / Fall Time t R ,tF -- 2 5 E Pulse Width (High, Low) tw 450 - - ns (5) Read Mode R/W and RS Setup Time tsu 60 - - (refer to Fig-16) R/W and RS Hold Time t H 20 - - Data Output Delay Time t D - - 360 Data Hold Time t DH 5-- Serial Clock Cycle Time tc 1 - 20 µs Serial Clock Rise/Fall Time t R ,tF -- 5 0 Serial Clock Width (High, Low) tw 400 - - (6) Serial Chip Select Setup Time tsu1 60 - - Interface Mode Chip Select Hold Time t H 12 0 - - n s (refer to Fig-17) Serial Input Data Setup Time tsu2 200 - - Serial Input Data Hold Time t H 2 200 - - Serial Output Data Delay Time t D - - 360 Serial Output Data Hold Time t DH 5--

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD F i g - 1 5 . W r i t e M o d e F i g - 1 6 . R e a d M o d e

KS0075 34COM/100SEG DRIVER & CONTROLLER FOR DOT MATRIX LCD F i g - 1 7 . S e r i a l I n t e r f a c e M o d e Reset Timing Item Symbol Min Typ Max Unit Reset low level width (refer to Fig-18) tRES 10 - - ms